{"id":1629,"date":"2020-01-01T19:59:00","date_gmt":"2020-01-01T22:59:00","guid":{"rendered":"http:\/\/pc5.frbb.utn.edu.ar\/frbb\/?p=1629"},"modified":"2025-10-28T18:48:39","modified_gmt":"2025-10-28T21:48:39","slug":"5537tc","status":"publish","type":"post","link":"https:\/\/www.frbb.utn.edu.ar\/frbb\/scyt\/proyectos\/finalizados-con-incentivo\/5537tc\/","title":{"rendered":"5537TC Sistemas Embebidos en Dispositivos L\u00f3gicos Configurables (FPGA)"},"content":{"rendered":"\n<div class=\"row\">\n  <div class=\"col-md-6\">\n    <p><strong>Grupo\/UCT: <\/strong> SITIC<\/p>\n      <strong>Director:<\/strong> CAYSSIALS, Ricardo Luis<br>\n      <strong>Co-Director:<\/strong> DE PASQUALE, Lorenzo\n     <\/p>\n    <p> <strong>Fecha  de Inicio<\/strong>: 01\/01\/2020     <strong> Fecha de  Finalizaci\u00f3n<\/strong>: 31\/12\/2022<\/p>\n    <!--<p> <strong>Tipo de proyecto:<\/strong>: PID EQUIPOS EN CONSOLIDACI\u00d3N CON INCENTIVOS TIPO A<\/p> -->\n  <\/div>\n  <div class=\"col-md-6\">\n    <p style=\"text-transform:capitalize\"><strong>Integrantes del Proyecto<\/strong><br>\n    INVESTIGADORES TESISTAS: Laiuppa Adri\u00e1n H\u00e9ctor; Amado Mart\u00edn Hugo; Mosquera Jos\u00e9 Carlos; Iparraguirre Javier<br>\n    <\/p>\n  <\/div>\n<\/div>\n<div style=\"padding-bottom:20px\"><\/div>\n<div class=\"row\">\n  <div class=\"col-md-12\">\n   <p>Actualmente, los sistemas digitales son utilizados en un muy amplio rango de aplicaciones. La evoluci\u00f3n tecnol\u00f3gica ha permitido el desarrollo de aplicaciones no factibles solo unos a\u00f1os atr\u00e1s. Sin embargo, los requerimientos cada vez m\u00e1s exigentes impuestos por las aplicaciones y el mercado fuerzan el desarrollo de t\u00e9cnicas y metodolog\u00edas de dise\u00f1os flexibles, eficientes y con niveles elevados de abstracci\u00f3n para dominar las crecientes complejidades de las implementaciones. La industria del software ha revolucionado las t\u00e9cnicas de dise\u00f1o introduciendo m\u00e9todos Agile basados en el modelo de prototipado (prototype model) que flexibilizan la especificaci\u00f3n, la verificaci\u00f3n y la validaci\u00f3n de las aplicaciones durante todo el ciclo de dise\u00f1o y vida de la aplicaci\u00f3n. <\/p>\n        <p>Es necesario entonces, desarrollar m\u00e9todos el dise\u00f1o, verificaci\u00f3n, validaci\u00f3n, actualizaci\u00f3n y mantenimiento arm\u00f3nico de hardware y software para la realizaci\u00f3n de sistemas flexibles y adaptables a las aplicaciones. En este contexto, el dise\u00f1o concurrente (codise\u00f1o) de Hardware y Software (HW\/SW Co-Design) propone una alternativa para abordar las nuevas exigencias con una mayor abstracci\u00f3n a la hora de determinar las funcionalidades delegadas en el software y aquellas delegadas al hardware de un sistema particular. Las modernas tecnolog\u00edas de dispositivos l\u00f3gicos configurables (FPGA) permiten aplicar t\u00e9cnicas de dise\u00f1o flexibles que admiten re-dise\u00f1os de hardware no disruptivos del proceso, admitiendo migraciones de funciones del software al hardware y viceversa, optimizando adem\u00e1s aspectos no funcionales como por ejemplo, el consumo de energ\u00eda. <\/p>\n        <p>Esta migraci\u00f3n flexible entre la implementaci\u00f3n de funciones del software y el hardware ha dado lugar a las actuales t\u00e9cnicas de dise\u00f1o concurrente HW\/SW desarrollados en proyectos anteriores y su continuaci\u00f3n es motivaci\u00f3n del objetivo propuesto para el presente proyecto. Sin embargo, la definici\u00f3n de las funcionalidades delegadas al sobre y las delegadas al hardware determinan las t\u00e9cnicas utilizadas en cada uno de estos dominios. Mientras que el desarrollo de hardware involucra se\u00f1ales, eventos, relojes, el desarrollo de software involucra variables, funciones, clases. Esta diferencia entre dominios dificulta la consideraci\u00f3n hol\u00edstica de los dise\u00f1os. En el proyecto anterior se propuso preliminarmente una plataforma para el dise\u00f1o, verificaci\u00f3n y validaci\u00f3n de sistemas de HW\/SW integradas con resultados alentadores para ser continuados en esta nueva etapa. <\/p>\n    <p>Por otro lado, las restricciones temporales que imponen las aplicaciones requieren la utilizaci\u00f3n de metodolog\u00edas de tiempo real para garantizar su correcto funcionamiento. T\u00e9cnicas y metodolog\u00edas de codise\u00f1o HW\/SW eficientes y modernas deben considerar las especificaciones temporales desde el comienzo del flujo de dise\u00f1o para permitir procesos acordes a las aplicaciones actuales. <\/p>\n\n    <p>El objetivo del presente proyecto es el desarrollo de metodolog\u00edas basadas en la utilizaci\u00f3n de t\u00e9cnicas de descripci\u00f3n de hardware, dispositivos l\u00f3gicos configurables, soft-processors y t\u00e9cnicas de s\u00edntesis de alto nivel (HLS) para la especificaci\u00f3n y dise\u00f1o de arquitecturas adaptables a los requerimientos temporales de diferentes aplicaciones cr\u00edticas y d\u00e9bilmente cr\u00edticas, conservando la versatilidad de uso de las arquitecturas de prop\u00f3sito m\u00e1s general. Estas metodolog\u00edas tendr\u00e1n en cuenta patrones de especificaci\u00f3n para el dise\u00f1o y verificaci\u00f3n de arquitecturas que, orientadas a dispositivos FPGA, presentan componentes de hardware y software fuertemente vinculados en forma hol\u00edstica. Este objetivo est\u00e1 en concordancia con las actividades de investigaci\u00f3n y desarrollo realizada en el PID anterior y se puede considerar como su natural continuaci\u00f3n.<\/p>\n  <\/div>\n<\/div>\n","protected":false},"excerpt":{"rendered":"<p>5537TC Sistemas Embebidos en Dispositivos L\u00f3gicos Configurables (FPGA). Director: CAYSSIALS, RICARDO LUIS. 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